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U(1)对称随机电路中酉设计形成的最优标度：比电荷传输更慢的瓶颈
Optimal Scaling of Unitary Design Formation in $U(1)$-Symmetric Random Circuits: A Bottleneck Slower than Charge Transport
arXiv:2609.39458v1阅读论文 PDF ↗
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作者：Toshihiro Yada
首次提交：2026-09-30 18:27
研究任务与主要进展
基于论文摘要，作者确定U(1)对称随机电路中酉k设计形成速率的最优标度，适用于k≤及晶格、扩展图和全连接等几何。作者报告，k≥2时形成速率由两个随机游走者的相遇速率控制，而非单粒子电荷传输，并通过辅助子群集合方法推导匹配下界；此外，论文提出用破对称局域门规避该瓶颈、实现更快设计形成的协议。
阶段、条件与复现 · 深读核对
- 任务输出与输入访问模型是什么？
- 在什么假设、规模与资源条件下成立？
- 与哪种经典基线比较，是否计入编码与读出？
这些是阅读核对问题；材料未说明的条件保留未知。请结合上方论文版本、资料范围与原文核验。
本站判断
该工作针对U(1)对称随机电路中酉设计形成速度是否由电荷传输决定这一问题，给出k不超过O(√log N)时、涵盖晶格、扩展图和全连接等几何的最优标度。作者报告形成速率由双粒子相遇速率控制，并以辅助子群集合方法给出匹配下界；同时提出利用破对称局域门加速设计的协议。当前材料仅为论文摘要，具体证明细节、比较基线和协议代价尚未说明。
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