STAR部分容错架构与中性原子平台协同设计研究
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STAR部分容错架构与中性原子平台协同设计研究
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AI 综述
Stefano Veroni 等在 arXiv 论文中提出将 STAR 部分容错架构与中性原子平台协同设计，把 Rydberg 门的噪声特性接入逻辑错误建模与应用层性能分析。 作者报告，在表面码的电路级模拟中，利用 171Yb Rydberg 门的噪声偏置和误差选择性脉冲优化抑制逻辑相干噪声后，逻辑错误较此前估计降低一个数量级以上；作者称该方案适用于约 10^-3 的中等错误率和数千量子比特规模。论文还针对周期边界条件的 Fermi-Hubbard 模型设计了适合早期实现的对数线路。 上述结果来自作者的电路级模拟与论文声称，尚属研究阶段，报道未提及硬件实验验证或独立复现。
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最新进展10月20日 12:00
中性原子阵列中部分容错架构的端到端优化报道时间线
沿着报道，了解事件的不同侧面。
10月20日
- arXiv · quant-ph中性原子阵列中部分容错架构的端到端优化
研究提出面向中性原子平台的 STAR 部分容错架构联合优化方法，并报告电路级模拟中逻辑错误较此前估计降低一个数量级以上。作者利用171Yb Rydberg门的噪声偏置和误差选择性脉冲优化，分析逻辑相干噪声抑制，并为周期边界 Fermi-Hubbard 模型设计早期实现适用的模拟线路。
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