提出容错电路自动缩减方法
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提出容错电路自动缩减方法
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报道摘要
Jeon、Lee 和 Kim 提出通过故障等价重写自动优化容错电路的方法，在保持输入电路容错性质的同时寻找更低资源或更高逻辑性能的候选电路。针对[[7,1,3]]码的Shor式综合征提取，摘要报告一轮辅助比特制备从30降至18、CNOT门从54降至42；在物理双比特错误率p=10^-3时，逻辑错误率约降低21%。
摘自 arXiv · quant-ph
最新进展10月7日 17:38
研究提出自动重写方法降低容错电路资源与逻辑错误率报道时间线
沿着报道，了解事件的不同侧面。
10月7日
- arXiv · quant-ph研究提出自动重写方法降低容错电路资源与逻辑错误率
Jeon、Lee 和 Kim 提出通过故障等价重写自动优化容错电路的方法，在保持输入电路容错性质的同时寻找更低资源或更高逻辑性能的候选电路。针对[[7,1,3]]码的Shor式综合征提取，摘要报告一轮辅助比特制备从30降至18、CNOT门从54降至42；在物理双比特错误率p=10^-3时，逻辑错误率约降低21%。
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